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网友想用外部33.1776M有源晶振,太贵,完美解决方案

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发表于 2022-12-3 09:58:18 | 显示全部楼层 |阅读模式
外部晶振 11.0592MHz*12=132.7104MHz, 锁相环时钟;  132.7104MHz/4 = 33.1776MHz 时钟给 CPU, 这样STC32G12K128工作在 33.1776MHz 时钟, 完美!!!!!!!
STC32规格书下载:https://www.stcai.com/filedownload/635668
stc-isp-15xx-v6.91-完整版.zip:https://www.stcai.com/filedownload/639549

STC32G12K128 的 PLL时钟.jpg
STC32G12K128 的 PLL时钟2.jpg
时钟分频寄存器.jpg
系统时钟选择寄存器.jpg

设置外部晶振是12MHz以下,提高抗干扰能力.jpg


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发表于 2022-12-3 10:16:37 | 显示全部楼层
内部增加的外部晶振抗干扰电路.jpg
这是内部增加的外部晶振抗干扰电路,是STC花了成本坐在MCU内部的,一定要启动,不用就太可惜了
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发表于 2022-12-3 13:33:48 | 显示全部楼层
STC32F12K60什么时候出呢?
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发表于 2022-12-3 14:02:17 | 显示全部楼层
做光罩中,春节后了
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发表于 2023-7-11 11:53:26 | 显示全部楼层
请问一下在 stc32G12K128芯片中,“使用外部晶振 11.0592MHz*12=132.7104MHz, 锁相环时钟=132.7104MHz”
这个描述中, 外部晶振11.0592MHz 进行12倍频 是如何设置的, 没有看懂,请指点一下,谢谢!
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发表于 2023-7-13 10:27:36 | 显示全部楼层
是不是这样理解:
PLL并不是真正保持锁频于96MHz或者144MHz,而是仅仅实现了8倍或12倍倍频后输出,
当使能PLL输出96M时,PLL的实际输出频率 = PLL输入频率 *8;
当使能PLL输出144M时,PLL的实际输出频率 = PLL输入频率 *12;
请确认一下这样理解是否正确, 谢谢!
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发表于 2023-7-15 19:15:59 | 显示全部楼层
看到网站例程说明 和 STC32F的技术手册 已经明白了。
但是,STC32G 的技术手册中没有 关于 HPLLCR 的描述, 所以暂时理解为 只有 STC32F 芯片才支持 PLL 的输出设置吧???

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您更新一下数据手册到20230714 STC32G系列和STC32F系列都是支持的  详情 回复 发表于 2023-7-17 09:45
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发表于 2023-7-17 09:45:51 | 显示全部楼层
机灵*** 发表于 2023-7-15 19:15
看到网站例程说明 和 STC32F的技术手册 已经明白了。
但是,STC32G 的技术手册中没有 关于 HPLLCR 的描述,  ...

您更新一下数据手册到20230714  STC32G系列和STC32F系列都是支持的
1.png

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发表于 2023-7-17 21:29:59 | 显示全部楼层
收到,马上更新手册,谢谢!
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发表于 2024-8-4 15:41:37 | 显示全部楼层
6#的理解是对的,PLL就是升频,96MHz就是升8倍,144MHz就是升12倍。手册上有介绍,STC单片机的PLL输入是有限制的,范围在8~16MHz之内。STC8H有部分新出的单片机也支持PLL的,以后估计PLL会成为标配。
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