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简简单单 做个STC8H2K32U核心板

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  • TA的每日心情
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    9 小时前
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    发表于 2024-6-11 14:24:37 | 显示全部楼层 |阅读模式
    基于STC8H2K32U单片机做了个核心板,保留了比较基本的资源,特性如下
    • 全部IO均通过排针引出,对部分乱序IO进行了分组排序
    • 具有USB-TYPE-C接口,用于USB开发,调试,下载
    • 具有一键冷重启功能,可代替复位
    • 具有一路外部中断兼USB HID Wirter烧写模式触发
    • 具有TL431外部2.5V基准源
    • 具有电源指示灯和2路IO控制LED指示灯,与PWM4复用,兼PWM输出指示
    • 具有外部小容量I2C接口EEPROM
    • 具有3.3V LDO,通过排针处跳线选择5V或3.3V供电,可接入外部供电,也可对外供电
    • 具有电源口5V TVS防护,具有USB接口ESD防护
    • 具有电源口自恢复保险过流防护
    • 具有可选32768Hz晶体,便于调试内部RTC
    • 宽体36脚封装,800mil间距,不支持活动座,支持面包板使用,

    QQ截图20240611132748.png
    3D_电路板_2024-06-11.png
    微信图片_20240611140925.jpg
    附件为部分基础例程,不定期更新中

    例程.rar (702.95 KB, 下载次数: 6)

    睁开眼睛做场梦~~~
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  • TA的每日心情
    奋斗
    13 小时前
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    发表于 2024-6-11 14:55:30 来自手机 | 显示全部楼层
    这板蛮漂亮的,功能也全啊
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  • TA的每日心情
    开心
    13 小时前
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    [LV.7]常住居民III

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    发表于 2024-6-11 15:16:19 | 显示全部楼层
    板子做得很好看!
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  • TA的每日心情
    开心
    9 小时前
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    发表于 2024-6-11 15:40:49 | 显示全部楼层
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    发表于 2024-6-11 16:22:05 | 显示全部楼层
    截图202406111621339358.jpg
    P1.2/P5.4/nRST
    P1.2回来了
    截图202406111623067723.jpg
    截图202406111623507772.jpg


    截图202406111624482613.jpg


    截图202406111625257800.jpg

    点评

    好的,P54就是占用P12的位置,按顺序排列的,下次把两个标识都印上。  详情 回复 发表于 2024-6-11 17:17
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  • TA的每日心情
    开心
    9 小时前
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     楼主| 发表于 2024-6-11 17:17:26 来自手机 | 显示全部楼层
    神农鼎 发表于 2024-6-11 16:22
    P1.2/P5.4/nRST
    P1.2回来了

    好的,P54就是占用P12的位置,按顺序排列的,下次把两个标识都印上。
    睁开眼睛做场梦~~~
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  • TA的每日心情
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    发表于 2024-6-11 21:38:06 | 显示全部楼层
    做的挺漂亮的,个人有一点小建议说出来别介意:从目前接触的情况来看,
    还没见过很理想的按照IO口顺序编程,基本都是管脚的实际用途直接搞。
    其实有时候想着,如果初学就从产品思维的角度去接受,也不见得是坏事。
    水平比较次,毕业14年重新拾起来单片机时间也不长,如果说错了,莫怪。
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    9 小时前
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     楼主| 发表于 2024-6-12 10:14:27 | 显示全部楼层
    Yim_Hom 发表于 2024-6-11 21:38
    做的挺漂亮的,个人有一点小建议说出来别介意:从目前接触的情况来看,还没见过很理想的按照IO口顺序编程, ...

    这个核心板应该和产品没什么瓜葛的,主要用途是日常验证功能,
    IO顺序排列单纯为了便于查找,由于芯片的IO本来就是顺序的,
    这样布局也没额外付出什么代价,
    我没get到你的建议,不明白你的意思,不过还是要谢谢你~
    睁开眼睛做场梦~~~
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    发表于 2024-6-12 14:05:15 | 显示全部楼层
    现在的排列就是 P1口打乱了,
    这是太多的合理考量造成的,是最优安排
    如外部晶振管脚要兼容,USB要外部挂电容...

    截图202406121404262718.jpg
    截图202406121406231397.jpg


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     楼主| 发表于 2024-6-12 15:56:56 | 显示全部楼层
    神农鼎 发表于 2024-6-12 14:05
    现在的排列就是 P1口打乱了,
    这是太多的合理考量造成的,是最优安排
    如外部晶振管脚要兼容,USB要外部挂电 ...

    IO乱序其实并没多少影响,因为并行总线的外设越来越少了,而且MCU发展的最终形态是没有端口分组的,内部大部分资源可以自由定义到任意IO上。
    睁开眼睛做场梦~~~
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